VLSI晶体管级时延模拟方法

来源 :计算机辅助设计与图形学学报 | 被引量 : 6次 | 上传用户：xingzhe1689

【摘要】

：

提出了一种新的晶体管级时延模拟方法,为了保证模拟的精度,综合考虑了存在于短沟道晶体管中的短路电流、输入/输出耦合电容和载流子速度饱和等效应对MOSFET晶体管沟道电流的影响,针对经典的ALPHA沟道电流分析模型(Alpha-Power-Law)进行了改良,以达到精确计算沟道电流的目的·该方法通过改良的节点分析方程(MNA)计算逻辑门的输出波形,以获得逻辑门的时间延迟和跳变时间·所开发的晶体管级时延

【作者】

：

骆祖莹钟燕清

【机构】

：

北京师范大学电子工程系,中国科学院计算技术研究所计算机系统结构重点实验室

【出处】

：

计算机辅助设计与图形学学报

【发表日期】

：

2006年12期

【关键词】

：

VLSI 纳米工艺晶体管级静态时延分析 VLSI nanometer technology transistor level static delay

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