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针对高速通信调制解调系统对成形滤波器的运算要求,分析高速并行滤波器的设计与实现方法,提出一种可满足1Gsps符号速率下的发射端和接收端的成形滤波器并行实现结构,该结构具有较低的实现复杂度。FPGA实现结果表明,采用该滤波结构的高速调制解调系统基本没有性能损失。
基于FPGA的高速并行滤波器设计与实现
【摘 要】
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针对高速通信调制解调系统对成形滤波器的运算要求,分析高速并行滤波器的设计与实现方法,提出一种可满足1Gsps符号速率下的发射端和接收端的成形滤波器并行实现结构,该结构具
【机 构】
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中国电子科技集团公司第二十研究所
【出 处】
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现代导航
【发表日期】
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2018年05期
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