【摘 要】
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频率合成技术作为频率源的主要方向被越来越多的应用于现代电子通信系统中，扮演了极为重要的角色。由于近年4G通信和物联网等产业的不断发展，无线通信对数据传输率的要求逐渐提
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频率合成技术作为频率源的主要方向被越来越多的应用于现代电子通信系统中，扮演了极为重要的角色。由于近年4G通信和物联网等产业的不断发展，无线通信对数据传输率的要求逐渐提高，射频前端的本振频率源成为设计的关键环节。频率合成器的跳频时间决定了通信系统的信道切换速度，特别在军事跳频通信，跳频速度越快越难以被跟踪，这有利于提高通信的安全性。更高的集成度、更宽的工作频率、更低的杂散和相位噪声以及更快的锁定时间一直是国内外研究锁相环频率综合器的热点。 本文首先介绍了频率源的技术背景、实现方式及国内外的发展状况。接着论述了锁相频率合成技术的基本指标和理论。然后在分析项目指标的基础上，着重讨论了提高跳频时间的方案，包括DDS与PLL的混合结构，电压预置法，动态环路带宽法，分析其优缺点。在综合考虑杂散、相位噪声等指标的条件下，提出了基于小数分频锁相环的动态环路带宽法，设计出环路结构，并对比ADIsimPLL和ADS两个软件的仿真结果，验证了可行性也指出了跳频时间的不足，因此提出改进的方案，进一步缩短跳频时间，改进后的仿真结果符合项目需求。 在各模块仿真设计通过后，进行了实物制作与测试。在1.4GHz到1.66GHz的频带内实现了1MHz的频率步进，并重点给出了杂散、相位噪声、输出功率和跳频时间的测试结果，性能达到了指标要求，并分析实际出现的问题，提出改进建议。
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