【摘 要】
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本文对基于EPON系统的信道编译码技术与硬件实现进行了研究。文章首先介绍了信道编码技术的基本理论和差错控制的基本方式，然后重点分析了802.3协议中CRC码技术的要求，根据协议
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本文对基于EPON系统的信道编译码技术与硬件实现进行了研究。文章首先介绍了信道编码技术的基本理论和差错控制的基本方式，然后重点分析了802.3协议中CRC码技术的要求，根据协议对CRC码算法和硬件实现进行了研究，提出了改进的并行CRC算法，接着运用FPGA(现场可编程门阵列)技术通过QuartusⅡ、SOPCBuilder和NiosⅡSDK等软件工具完成了NiosⅡ用户自定义指令的实现，不仅进行了功能仿真，而且实现了开发板上的验证，为EPON系统平台的验证建立了基础，最后根据EPON帧校验的具体要求，在0.35μm工艺下通过Cadence和Synopsys工具并基于流水线技术对CRC编译码器进行了重新设计及ASIC(ApplicationSpecificIntegratedCircuit)实现，该硬件电路与用通用算法实现的结果相比，控制单元更简单，数据处理速度更快。我们设计的编译码器芯片面积为2.56mm2，数据吞吐量为125Mbit/s。
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