【摘 要】
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随着雷达信号处理技术的不断发展,传统的雷达信号处理系统难以满足实时高速的处理需求,而且传统处理系统的设计、通用性和扩展能力较差,这时就需要对雷达信号处理设备性能提
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随着雷达信号处理技术的不断发展,传统的雷达信号处理系统难以满足实时高速的处理需求,而且传统处理系统的设计、通用性和扩展能力较差,这时就需要对雷达信号处理设备性能提出更高的要求。因此设计并实现以标准总线为基础,高速DSP芯片为核心组成的通用并行处理系统成为当今高速实时信号处理系统发展的趋势。本论文主要完成了通用雷达信号处理平台的设计。设计中采用了基于高性能DSP+FPGA混合结构的通用信号处理硬件系统,并在此硬件平台上实现了RocketIO、链路口的高速通信设计以及基于FPGA的CPCI总线接口设计。讨论并实现了RocketIO串行传输两种协议的设计。最后运用现代高速PCB设计技术结合硬件仿真技术对该信号处理平台关键网络的拓扑结构进行了仿真,提高了该硬件平台的稳定性与准确性。
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