【摘 要】
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该文设计了基于PCI总线的高速业务接入芯片中的数个核心电路模块:多通道高速HDLC处理器、物理接口模块和多通道高速数据缓冲区的管理和控制模块.其中多通道HDLC处理器芯片模
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该文设计了基于PCI总线的高速业务接入芯片中的数个核心电路模块:多通道高速HDLC处理器、物理接口模块和多通道高速数据缓冲区的管理和控制模块.其中多通道HDLC处理器芯片模块可以同时处理8个E1链路,最大128个逻辑通道.其基本工作原理是:首先对128个低速的HDLC通道的数据进行缓冲,然后使用一个具有分时处理能力的高速HDLC处理器,通过时分复用的方式进行数据的处理.该文设计的所有电路模块均由Xilinx公司的FPGA—XV600-6(60万逻辑门)实现,在实时操作系统VxWorks中进行了硬件的功能验证,且和同类型通信芯片,如Conexant公司的CN8474进行了对通,验证了HDLC规范的一致性.
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