【摘 要】
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随着集成电路制造水平的不断提高和便携式电子系统的高速发展,大规模集成电路设计的重点已经从高速度转为低功耗.该论文重点探讨了低功耗集成电路所涉及的一些设计技术,在此
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随着集成电路制造水平的不断提高和便携式电子系统的高速发展,大规模集成电路设计的重点已经从高速度转为低功耗.该论文重点探讨了低功耗集成电路所涉及的一些设计技术,在此基础上作了一些低功耗的设计实践.该文探讨了实现乘法器功耗优化的技术.我们对乘法器中用到的全加器和半加器进行了逻辑类型的优化,采用互补传输门逻辑代替传统的静态互补CMOS逻辑,可以大大简化电路结构,节约硬件开销,从而降低电路功耗;另外,为了减少电路内部节点的伪转换,该文采用了一种自定时低功耗控制电路,可以控制Wallace Tree化简阵列的输出伪转换和超前进位加法器的输出伪转换.最后基于以上理论,作者利用Cadence和Synopsys等EDA设计工具完成了一个32×16位乘法器的逻辑设计.仿真结果表明电路的实现是正确的.
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