基于FPGA的LDPC译码器设计

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LDPC码即低密度奇偶校验码,是麻省理工学院博士Gallager在1962年博士论文中提出的一种接近香农极限的编解码方案。LDPC码已经成为IEEE 802.16e、UWB和WiMax的标准编解码方案,并成为下一代移动通信标准。本设计采用FPGA硬件电路平台作为全并行译码设计平台,译码算法采用概率域软判决算法。通过FPGA的查找表功能实现译码算法中的tanh函数和反tanh函数。本设计所做主要工作有以下几点:1、在FPGA中实现了C语言中的指针操作,使得LDPC码的校验矩阵即稀疏矩阵可以只存储1的位置,大大节省了存储资源,提高了数据存取读出速度,节省了数据读取时间。2、乒乓操作法的引入,完成了数据的无缝缓冲与处理。实现了译码模块的不间断工作,消除了数据读取停顿的缺点。3、C++中标记粘贴运算符在FPGA开发中成功运用,运用SystemVerilog加强型宏定义,在变量节点例化和校验节点的例化中,大大减小了代码书写量。本设计在500MHz的时钟频率下,实现了在迭代最大次数为20次的条件下,LDPC译码速率可达0.24Gbps。
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