【摘 要】
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该论文从SOC设计的角度出发,设计实现了JPEG CODEC和静止图像处理器,并且成功集成在140成像素的数码相机芯片中.JPEG CODEC的系统集成设计实现了一个压缩和解压缩流程硬件共
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该论文从SOC设计的角度出发,设计实现了JPEG CODEC和静止图像处理器,并且成功集成在140成像素的数码相机芯片中.JPEG CODEC的系统集成设计实现了一个压缩和解压缩流程硬件共享的流水线结构,建立了良好的数据传输和反馈机制,并且合理规划了数据缓冲区,同时在设计中部分采用容错设计,提高了系统可靠性.该论文同时提出了一种新颖的二维DCT/IDCT的硬件实现.设计在正向和逆向变换过程中对主要的算术运算单元采用硬件复用的方法,达到了面积优化的目的;并对输入数据进行系数预判,在特定输入情况下有效提高了处理速度和降低功耗;还根据JPEG体系结构,在DCT变换和量化器之间建立动态的精度匹配,保证了不同压缩比下的图像质量和功耗效率.在整个设计过程中,该论文对SOC设计中的关键技术进行了研究和实践.主要包括硬件复用和多种低功耗设计技术,同时对流水线结构数据处理的内在冲突进行了分析并且提出了一些优化算法的思想.
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