【摘 要】
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现今，人们对于通信的速率和实时性要求越来越高。UMTSHSPA+系统一方面能够满足高速的速率要求，另一方面，该系统可以由现有的系统升级得到，最大限度的维护运营商的利益。本项目基
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现今，人们对于通信的速率和实时性要求越来越高。UMTSHSPA+系统一方面能够满足高速的速率要求，另一方面，该系统可以由现有的系统升级得到，最大限度的维护运营商的利益。本项目基于2片TMS320C6474 DSP和2片FPGA实现上行2载波，下行4载波的UMTS HSPA+的测试终端。为了满足业务数据信道HS-PDSCH处理的准确性和实时性，最重要的是其控制信道HS-SCCH解析的准确性和实时性。HS-SCCH信道的处理主要难点是维特比译码，由于HS-SCCH的处理采用盲检方式，一片DSP最多需要处理12条HS-SCCH信道，如果采用DSP进行维特比译码的工作，那么现有的CPU资源不可能满足系统的时序要求。因此，本项目采用DSP硬件加速器来进行维特比译码的，极大的提高了CPU的利用率，较好的解决了本项目中部分信道维特比译码的准确性和时延的问题。
本文讨论了卷积码的编码原理以及表示方法，详细分析了维特比译码的原理。简要介绍了TMS320C6474 Viterbi Coprocessor(VCP2)的工作原理和特性。对TI官方文档提供的分支度量计算函数进行了多种方法的优化，使得该函数的计算效率提高了50倍。根据本项目的实际需要分析了TI提供的计算分支度量算法的不合理性并进行了适当修改。根据BCH信道译码过程中出现的问题，发现了文档中分支度量取值范围的不合理性并提出了改进方法。本项目使用基于寄存器地址的配置方法进行EDMA通道配置，大大简化了配置流程。最后对所设计的VCP2进行了在板测试。测试结果表明该VCP2的性能和效率能够满足实际UMTS HSPA+系统的需要。
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