【摘 要】
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针对系统芯片设计和媒体应用发展，以及系统件能的需求，根据频率指标和流水线的关系，采用可重用性和可配置性策略设计了9+级流水线的处理器IP核Gemini。为验证此IP核设计的功能正
【机 构】
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浙江大学信息与电子工程学系杭州310027
【出 处】
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中国电子学会电路与系统学会第二十二届年会
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针对系统芯片设计和媒体应用发展，以及系统件能的需求，根据频率指标和流水线的关系，采用可重用性和可配置性策略设计了9+级流水线的处理器IP核Gemini。为验证此IP核设计的功能正确性，利用现场可编程阵列(Field-Programmable Gatearray，FPGA)的硬件平台，通过EJTAG(Enhanced Joint Test Action Group)接口进行了在线调试;在FPGA平台上利用Linux操作系统和EEMBC测试集评测此IP核的功能和性能。通过TSMCl30nmCMOS工艺，检查此IP核的时序，逻辑综合结果表明在最差情况下，处理器频率为360MHz。
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