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本文介绍一种纳秒延时技术的产生原理和研究成果。该技术采用CPLD大规模可编程逻辑技术与延迟线技术的结合,实现了延时精度1 ns;延时步进1ns;延时范围1ns～500us;输出脉冲幅度3～10V;脉冲前沿好于2ns;负载50Ω;可独立输出3路延时脉冲。
多路纳秒延时同步控制技术研究
【摘 要】
：
本文介绍一种纳秒延时技术的产生原理和研究成果。该技术采用CPLD大规模可编程逻辑技术与延迟线技术的结合,实现了延时精度1 ns;延时步进1ns;延时范围1ns～500us;输出脉冲幅度3
【机 构】
：
中国工程物理研究院流体物理研究所;
【发表日期】
：
2004年期
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