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基于Verilog HDL的数字化多道预处理算法研究
基于Verilog HDL的数字化多道预处理算法研究
来源 :中国核学会2011年年会 | 被引量 : 0次 | 上传用户:sql70
【摘 要】
:
在研制基于FPGA的数字化多道脉冲幅度分析器的过程中,使用Verilog硬件描述语言完成FPGA中对数字信号的处理,包括梯形脉冲成形、基线估计、寻峰等.详细描述了梯形滤波成形的实
【作 者】
:
王珂;李政;魏义祥;方飞;
【机 构】
:
清华大学工程物理系,北京,100084 清华大学粒子技术与辐射成像教育部重点实验室,北京,100084
【出 处】
:
中国核学会2011年年会
【发表日期】
:
2011年期
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在研制基于FPGA的数字化多道脉冲幅度分析器的过程中,使用Verilog硬件描述语言完成FPGA中对数字信号的处理,包括梯形脉冲成形、基线估计、寻峰等.详细描述了梯形滤波成形的实现方式,解决了实现过程中数据溢出以及误差累积的问题.最后给出测得的137Cs能谱.
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