【摘 要】
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本文详细分析国产商密杂凑算法(SM3)的执行流程，并基于现场可编程门逻辑器件(FPGA)设计开发该算法的高性能硬件实现。针对目前SM3 算法在FPGA 上的消息填充实现不完整的问题，本文加入硬件消息填充模块，并进行针对性优化。实验结果表明，本文方案相比于其他SM3 算法实现拥有较好的吞吐率和逻辑资源占用。
【机 构】
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北京航空航天大学网络空间安全学院,北京 100191 北京航空航天大学网络空间安全学院,北京 10
【出 处】
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第十二届中国可信计算与信息安全学术会议
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本文详细分析国产商密杂凑算法(SM3)的执行流程，并基于现场可编程门逻辑器件(FPGA)设计开发该算法的高性能硬件实现。针对目前SM3 算法在FPGA 上的消息填充实现不完整的问题，本文加入硬件消息填充模块，并进行针对性优化。实验结果表明，本文方案相比于其他SM3 算法实现拥有较好的吞吐率和逻辑资源占用。
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