【摘 要】
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本文描述了基于Sparse-Tree结构的32位加法器电路设计与优化。首先根据Sparse-Tree算法设计出基于Sparse-Tree结构的电路,然后通过对电路模型的分析并结合对实际CMOS电路的模
【出 处】
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第十一届计算机工程与工艺全国学术年会
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本文描述了基于Sparse-Tree结构的32位加法器电路设计与优化。首先根据Sparse-Tree算法设计出基于Sparse-Tree结构的电路,然后通过对电路模型的分析并结合对实际CMOS电路的模拟确定加法器电路的关键路径,从而设计晶体管的基本尺寸。为了达到高性能并兼具低功耗的要求,随后对Sparse-Tree结构的电路进行了创新性的改进与优化设计。最后得到一个较优的结果:在标准工作环境下,采用Smic 0.13um工艺,工作电压1.2v的情况下延时为0.293ns,比改进前的设计在同等工艺下性能提高了30％。
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