【摘 要】
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随着集成电路工艺进入纳米时代,片上集成度不断提高,功耗和面积成为制约高性能微处理器设计的重要因素,必须在体系结构设计阶段就考虑工艺需求与实现,以加快设计的收敛。本文
【机 构】
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国防科技大学计算机学院 长沙410073
【出 处】
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第十七届计算机工程与工艺年会暨第三届微处理器技术论坛
论文部分内容阅读
随着集成电路工艺进入纳米时代,片上集成度不断提高,功耗和面积成为制约高性能微处理器设计的重要因素,必须在体系结构设计阶段就考虑工艺需求与实现,以加快设计的收敛。本文采用基于McPAT的体系结构级工艺模拟器对三种典型多核处理器架构进行模拟得到不同工艺节点下实现的性能、面积和功耗,给出了采用当前主流工艺实现三种处理器的规模,为未来设计高性能CPU提供工艺需求参考。
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