【摘 要】
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随着数据传输速率的不断提高，电子产品对模数转换器(ADC)的转换速率提出了越来越高的要求，然而精度和功耗限制了单通道ADC转换速率的进一步增长。当前，时间交织(Time-Interleaved)结构已成为实现高速模数转换器的首选，但该结构通道之间存在着失配问题，其中采样时钟偏差(Timing mismatch)尤为棘手。基于自相关(Autocorrelation)的采样时钟偏差校准方法因硬件实现复
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随着数据传输速率的不断提高，电子产品对模数转换器(ADC)的转换速率提出了越来越高的要求，然而精度和功耗限制了单通道ADC转换速率的进一步增长。当前，时间交织(Time-Interleaved)结构已成为实现高速模数转换器的首选，但该结构通道之间存在着失配问题，其中采样时钟偏差(Timing mismatch)尤为棘手。基于自相关(Autocorrelation)的采样时钟偏差校准方法因硬件实现复杂度较小而受到青睐，然而获得信号统计特征的过程较为缓慢，因此如何提高校准速度成为研究热点问题。本文提出了一种新颖的校准策略以提高基于自相关的采样时钟偏差校准的速度。不同于传统校准策略，该方案不再令各通道与参考通道的相关值收敛到峰值，而是收敛到其中某一通道的相关值，该通道与参考通道保持着一定的采样时间间隔τ。该策略能减弱相关函数的变化率减小对校准速度的负面影响，从而加速校准过程。新校准策略简单易行，采样时间间隔τ的选取自由度较大。并且用于计算相关值的数据只需要一位参与运算，亦不会出现传统校准策略存在的“死区”问题，大大降低了硬件开销。同时该策略也使采样时钟偏差校准与其他不匹配的校准过程独立开来，不再受到它们的牵制。将新校准策略应用到一个14位500MS/s的两通道交织ADC上，仿真结果显示，新策略对校准过程具有良好的加速效果。
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