【摘 要】
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对处理器设计的验证方法可分为软件方法和硬件方法。众核体系结构处理器的逻辑规模较大,软件方法验证速度较慢,一般采取使用FPGA搭建原型系统验证。在实践过程中发现,硬
【机 构】
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湖南省长沙市国防科技大学计算机学院 410073
【出 处】
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第十八届计算机工程与工艺年会暨第四届微处理器技术论坛
论文部分内容阅读
对处理器设计的验证方法可分为软件方法和硬件方法。众核体系结构处理器的逻辑规模较大,软件方法验证速度较慢,一般采取使用FPGA搭建原型系统验证。在实践过程中发现,硬件原型系统往往存在以下问题：(1)由于单块FPGA容量无法满足需求,需要把待验证逻辑映射到多FPGA实现。(2)原型系统搭建者往往在外设等非核心设计上花费大量精力。(3) FPGA进行片间互连时存在着带宽充足但延时较大的现象,与待验证的片上逻辑较难匹配。针对以上问题在设计Cluster on Chip (CoC)原型系统时,提出了一套基于多SOC_ FPGA混合芯片互连的验证平台方案,满足原型系统的逻辑容量需求并简化了外设设计。一个Smart link模块被加入系统,负责片间逻辑通信的延时隐藏。并基于此构建了一个8板,16芯片,128核的4×4 2D-mesh CoC原型系统。
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