【摘 要】
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基于NoC的多核处理器硬件设计规模和复杂度不断增加,单片FPGA硬件资源有限.针对这一问题,可以将需要处理的任务划分多个子任务分配到不同FPGA芯片上的处理单元分别处理,从而
【机 构】
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电子科技大学,四川 成都 611731
【出 处】
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第二十八届全国通信与信息技术学术年会
论文部分内容阅读
基于NoC的多核处理器硬件设计规模和复杂度不断增加,单片FPGA硬件资源有限.针对这一问题,可以将需要处理的任务划分多个子任务分配到不同FPGA芯片上的处理单元分别处理,从而实现任务处理的芯片级并行化,节省单芯片的资源开销.利用片问的高速串行接口实现片上网络的互联,单通道速率达到9.830 4 Gbps,实现了NoC的片间互联以及数据高速无误码的传输.
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