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本文主要讲述对256M DDR地址链表的管理,采用五级流水式的查找方法,并对设计代码进行了验证.
DDR地址链表管理的FPGA实现
【摘 要】
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本文主要讲述对256M DDR地址链表的管理,采用五级流水式的查找方法,并对设计代码进行了验证.
【机 构】
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光纤通信技术和网络国家重点实验室武汉邮电科学研究院,武汉 430074
【出 处】
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中国通信学会第六届学术年会
【发表日期】
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2009年期
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